Verilog HDL数字系统设计 王建民 著 阿里云 kindle 下载 pdf chm 百度云 azw3 umd

本书介绍基于Verilog HDL进行数字系统设计的基本原理、概念和方法。重点关注基于HDL的寄存器传输级数字系统设计，内容包括：数字电路基础回顾、组合逻辑电路设计、规则时序逻辑电路、有限状态机以及FSMD的设计。

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书籍介绍

《Verilog HDL数字系统设计》由王建民、田晓华、江晓林编著，通过

大量完整的实例介绍基于Verilog HDL进行数字系统设计的基本原理、概念

和方法。全书重点关注基于HDL的寄存器传输级(Register Transfer Level

，RTL)数字系统设计，主要内容包括数字电路基础回顾、组合逻辑电路设计

、规则时序逻辑电路、有限状态机以及FSMD的设计。本书所有代码兼容

Verilog HDL IEEE1364—2001标准。

尽管本书简单地回顾了数字电路的基本知识，但是如果读者能够掌握数

字电路的基本原理和设计方法对于阅读本书将是十分有意义的。本书适合高

年级的本科生、研究生以及从事数字电路设计的工程人员使用。